返回信息流请教一下数电大神,图里面clk第三个下降沿,为什么主触发器是置1的?在下降之前,j不是已经从1变为0了,那么我理解不就应该是置0的?我这么想哪里错了?
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这是一条镜像帖。来源:北邮人论坛 / circuit / #25965同步于 2015/8/13
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数字电路jk脉冲触发器的疑问
yizisad
2015/8/13镜像同步4 回复
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主从JK触发器在脉冲高电平之间无论J,K怎样变化,都只变化一次,就是高电平期间第一次的变化,之后就一直保持直到下降沿到来,在第三个脉冲高电平期间,JK先都是高电平,此时,主触发器的Q从第二个脉冲的低电平变成高电平,之后,就算J变成低电平,Q也不再变化,然后一直到第三个脉冲的下降沿到来,从触发器被置成1,
【 在 yizisad (yizisad) 的大作中提到: 】
: 请教一下数电大神,图里面clk第三个下降沿,为什么主触发器是置1的?在下降之前,j不是已经从1变为0了,那么我理解不就应该是置0的?我这么想哪里错了?
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例题上面的那一段说的不就是这个吗?
【 在 yizisad (yizisad) 的大作中提到: 】
: 请教一下数电大神,图里面clk第三个下降沿,为什么主触发器是置1的?在下降之前,j不是已经从1变为0了,那么我理解不就应该是置0的?我这么想哪里错了?
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太感激了,原来如此。只变化一次的原因是因为把输出信号接到了输入端这样吗?
【 在 hx0502001 的大作中提到: 】
: 主从JK触发器在脉冲高电平之间无论J,K怎样变化,都只变化一次,就是高电平期间第一次的变化,之后就一直保持直到下降沿到来,在第三个脉冲高电平期间,JK先都是高电平,此时,主触发器的Q从第二个脉冲的低电平变成高电平,之后,就算J变成低电平,Q
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是这样的,脉冲没变化之前,从触发器的输出是一直不变的,
【 在 yizisad (yizisad) 的大作中提到: 】
: 太感激了,原来如此。只变化一次的原因是因为把输出信号接到了输入端这样吗?
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