返回信息流大家好~我这几天遇到了一个技术问题，就是运行程序是verilog，然后testbench是systemverilog编写出来的，我想问一下，怎么在modelsim中对这个运行程序仿真啊？而且这个testbench有一个主文件，三个子文件，我就想问大家怎么调用啊？
这是一条镜像帖。来源：北邮人论坛 / communications / #27225同步于 2017/3/22
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modelsim技术问题求指教
Sophia2015
2017/3/22镜像同步0 回复
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