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“这种事，见多了就习惯了 【 在 wangxiaobupt 的大作中提到: 】 : 单片机别人的机子可以显示驱动成功 我的机子就不行啊”
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“噢噢，原来如此，了解了。灰常感谢！ 【 在 chrischen25 的大作中提到: 】 : 跨时钟域是指两个不同频率之间的时钟域有信号交互，你这个都工作在同一个时钟下，不是跨时钟域啊”
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“大致意思了解，可是感觉有点矛盾。用时序逻辑的话，A B C都用同一个时钟驱动，但是在t1时刻，B是处理t1-1时刻A输出的数据，这样不就必然跨时钟域嘛？ 【 在 chrischen25 的大作中提到: 】 : FPGA程序中最重要的原则 同步 流水，这要符合这两点，一般很难出错。能一个时钟域处理就不要跨时钟域。你想说的…”
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“目前打算用一个状态标志了，第一个clock,产生数据；第二个clk，做A处理；第三个，做B处理；第四个，做C处理。时钟速率是信号速率的4倍”
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“那应该要求时钟频率大于数据率吧？有可能实现一个时钟将数据都处理完并且输出么？ 【 在 kimi169 的大作中提到: 】 A.B模块用了几个clock 上面两路数据在C模块里面打几拍不就行了， 理论上好解决吧，注意下路径延迟问题，进组合逻辑之前，都用时序逻辑并且延迟相同时间是可以的吧 --”
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“把过孔布置之后再编辑它的net属性。或者先把过孔布在该net上，这样过孔就是和该net相连的，然后再拖动过孔”
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“应届生滚蛋前夕？”
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“图书馆随便借一本吧，肯定有一章专门讲自制元件”
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