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cordialz@cordialz
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“自学的话给自己设置一些小项目做 能跟着实验室做项目最好了 有人催着 偶尔还能有人指导”
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“EP3C40F484 毕设已经结束了 最终也没调 Vref总是不对 【 在 rhythm 的大作中提到: 】 : fpga用的那颗型号？”
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“有这门课么”
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“这俩规则应该不会影响到短路规则 即使线间距是0mil 也是不允许两个网络直接相连的 我用的是AD10 它是不允许删掉线间距规则的 删掉之后会自动添加10mil线间距的规则 99里面不知道是啥情况 你加上线间距规则试试？ 【 在 feijie 的大作中提到: 】 : 我的是~~勾不勾完全没区别啊~~不过我把线距离和器件距…”
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“额 应该把那个钩钩去掉的.....勾上是允许短路 不勾上是不允许 左侧的是选择允许的范围 【 在 feijie 的大作中提到: 】 : 我的那个规则前面是有勾的~~但是我的不同net之间还是可以相连的~~怎么回事啊？”
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“不是IBIS模型里面不包含结构特性么....只包含了端口的一组参数 比Spice模型简化 而且保密性强 【 在 police 的大作中提到: 】 : 其实高速的都是要死要活求着厂商给spice模型。。。厂商害怕你拿spice算出他的结构 : 来死都不愿意给你。。。 : : ...................”
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“挖坟的时候看到的.....电路版比较冷清.....虽然不知道为啥... 【 在 feijie 的大作中提到: 】 : 谢谢，终于有人回我了。”
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“规则里面 有个short circuit项 清掉就可以”
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