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“嗯，我要个具体过程就行了 我要仿真的核包括nco fir and so on”
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“编译altera库的问题已经解决了。原因是我建的altera库没有在$MODEL_TECH/../目录下，而是在之前建立的一个目录下边，所以编译的选项没有。将工作目录切换到$MODEL_TECH/../下在重新建立一个library就可以编译altera库了。 目前的问题还是如何仿真QuartusII生成的IP核文件，…”
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“做微电子，IC设计的话，verilog HDL用的相对较多一些。 现在一般是本科教VHDL，研究生教verilog。 VHDL学好对以后也是蛮有帮助的，尤其是理解硬件编程和软件编程之间的区别，所以，建议还是好好学习吧”
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“赵老师，去年我也选了这门课，主要目的却不是学通电，而是熟悉仪器，因为电设用的仪器就是那些。 一方面我觉得可能是学分的问题，通信电子电路实验1.5学分，而选修要求10学分。我一个同学去年也是通信电子电路，现在9.5分还差0.5.还需要在修一门课。 另一方面我觉得通信电子电路实验还是比较有难度的。去年我们做实验的时候，基本…”
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“赵老师上课啊”
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“木有必要”
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“zigbee?”
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“win or lin? windows版搜索CTEX LINUX版的看具体版本”
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