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leonzyz@leonzyz

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lz说的可是这个? http://www.altera.com/literature/ug/ug_low_level.pdf 【 在 mourny 的大作中提到: 】 : 最近在用到altera的stratixII,涉及要实现三态门之类的, : 想有个原语手册看看。 : 不过网上没搜到, : .............…

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好基情阿~~ 【 在 UZ 的大作中提到: 】 : 没有没有。。。我一直在

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我记得画波形有个叫drawtiming的开源软件,不过效果貌似有点挫 【 在 lanphon 的大作中提到: 】 : Visio就算了,操作太麻烦。 : 基本需求就是数字设计中,绘制逻辑波形,效果就跟逻辑分析仪差不多的那种波形图,用来分析时序 : 大家都用啥软件来画?之前手工画,累得死去活来不说,复用性还不强

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你赶紧去研究一下,然后写个教程啊亲 【 在 lanphon 的大作中提到: 】 : 求大神知道如何画波形~~

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你可以看看altera或者xilinx rom的primitive怎么写,找个例子照着写就行了 或者你像4l所说的那样,把你的reg改成wire: parameter choose_clk = 3;//1 2 3 parameter spi_wide = 8; parameter spi_num = 2; wire […

#6求助verilog2012/3/7
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你可以写到一个ROM的结构中,要用的时候去ROM里读 【 在 xzy 的大作中提到: 】 : parameter choose_clk = 3;//1 2 3 : parameter spi_wide = 8; : parameter spi_num = 2; : ...................

#1求助verilog2012/3/7
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年代久远,记不清了 不就是照着电路图连吗...用万用表捅一下该通的地方通了,不该通的地方没通不久行了 【 在 hjmzc 的大作中提到: 】 : 我们就是完全没有头绪所以求指导啊,其实不是面包板不会,我们就觉得电路图好复杂不知道从什么地方入手,要是你会的话可以私下联系吗,我口口号630727843,总之谢谢啦~

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@dzcs 这人也许知道

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