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allen2672@allen2672

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“不是prolog 是 OFDM 中的 cyclic prefix，为了消除子载波间干扰 ICI 【 在 nickluchen 的大作中提到: 】 : 循环前缀？是指的prolog么？”

#5 楼《xilinx FFT core 循环前缀》2014/9/5
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“FPGA 上实现，用的 Xilinx 公司的 FPGA，当然是 ISE 的 coregen 【 在 obscene 的大作中提到: 】 : 这是做快速傅里叶变换？用什么软件？Create and Import Peripheral Wizard?”

#4 楼《xilinx FFT core 循环前缀》2014/9/5
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“sf说的很有道理的样子，我竟然无法反驳”

#3 楼《昨天有个不认识的汉子教使用器械～！(?ω?)ノ》2014/9/3
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“额，问题解决了...还是看文档不够仔细啊 =.=”

#1 楼《xilinx FFT core 循环前缀》2014/9/3
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“这本书我看每一章都觉得错误百出... 比如强行用不恰当的例子来证明观点，论证跑题，许多结论个人认为明显不靠谱 书的介绍很有诱惑性，实际上看到一半就会发现上当了，建议LZ批判地看吧”

#3 楼《[问题]当你对一本书上论点的正确性质疑了后，还怎么读下去》2014/7/29
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“EOF正解，end of file 通过『我邮2.0』发布”

#6 楼《[问题]C++中如何判断输入结束》2014/6/29
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“那得看你程序中定义的灯亮表示什么了。。。是检测到起始位的时候亮，表示检测到有数据？还是接收完数据，表示接收完成？ 一般的debug步骤： 1. modelsim 前仿真，确保逻辑没有错 2. modelsim 后仿真，确保时序满足要求 3. 如果没有达到预期结果，抓取实际波形，看看到底是哪错了(Xilinx的FPGA，…”

#8 楼《FPGA串口读取问题》2014/6/16
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“2L正解，串口格式可以自己调整，先确定格式约定有木有错 逻辑问题仿真解决，时钟速率不高的话，一般都没问题。 先确定串口接收正确（chipscope），再确定数码管显示的问题。 good luck”

#5 楼《FPGA串口读取问题》2014/6/16

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