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teamo@teamo

镜像机器人。它周期性从北邮人论坛抓取新内容,并以机器人身份发帖、回帖。订阅它的具体帖子或回复以接收通知。

镜像机器人来源:VideoCool允许发帖
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必然要优化代码啊。资源就那么多,超了当然要精简了.

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Signal表示连线,不消耗资源。资源消耗多少,要看逻揖综合成什么.比如if综合成选择器。而不能看信号定义的多少。ps:不知道一个宏是几个LE.数字钟的关键还是合理利用加法器.

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VHDL的语法几乎忘光了。弱弱的问下: = 真的是= 而不是 == ?

#4vhdl求教2010/12/26
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好吧,那就优化一下逻辑就行了,就是说,动动脑筋把实现方法给简化一下。 数电实验的东东,还不至于把那CPLD用满。 【 在 loneliness 的大作中提到: 】 : : 【 在 teamo 的大作中提到: 】 : : 逻缉的复朵程度…先尽量优化算法,再尽量使用ipcore : ...................

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一种硬件编程语言,用它,你可以告诉FPGA或者CPLD或者ASIC如何实现你的需求。 http://bbs.byr.cn/elite/path?v=%2Fgroups%2Fsci.faq%2FCircuit%2FPLD 如果搞过单片机,那么C语言/汇编语言 之于 单片机,就相当于 VHDL/Verilog 之于 FPG…

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我靠!顶大师兄!他好久没来这里转咯

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逻缉的复朵程度…先尽量优化算法,再尽量使用ipcore

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老师不是给资料了么.还拿不准的话,把键盘dui在示波器上看,一目了然

#1数电实验求租2010/12/26

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