siliangfu@siliangfu
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“同步电路比较好，就是都在时钟上升沿的时候触发。你把你的if语句，case语句，重置等等都放到 if (clk'event and clk='1') then if cnt = div then --produce clk_m cnt<=1; clk_tmp<= not clk_tmp; else cnt<=cnt+1;…”
“可能是我之前没说清楚，我重新编辑了下。。。 【 在 PIR 的大作中提到: 】 : 自己加判断条件，不要依靠综合器，养成良好的设计习惯是关键 : -- : 生活可以随遇而安，但生命应该有所坚持…… : ...................”
“好东西还是得回家找呀，内牛满面~~”
“收到，谢谢哈！：） 【 在 lanphon 的大作中提到: 】 : 声明为reg型，综合不一定是寄存器。不过看第一个always模块，Tff肯定是综合成寄存器了 : 至于第二个，IDout显然综合成IDlock和Tff做输入的一个组合电路了，至于那个理解，只要IDclock或者Tff有变化就会触发此always模块，不…”
“貌似是需要一个license的”
“哈哈，略爽，但比hf感觉上差了些，hk可爽？ 【 在 kilometre 的大作中提到: 】 : 厦大可爽？ : --”
“动手，看软件里的注释，网上找实例（这个比较少，有些入门的）”
“【 在 kilometre 的大作中提到: 】 : : 后青春的诗·国际学院2005级毕业纪念晚会 : The Poetry of The Day After : ................... 期待你的作品哈~~：）”
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