Circuit
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都说IF比CASE有优先级判断， 那么对于 if···else语句和case两状态选择语句， 这貌似在C中是等价的， 不知道在VHDL中具体实现是不是有区别啊？
Modelsim貌似同时只针对一种语言？我一直用Verilog，集成到ISE里仿，现在用VHDL 仿不了，各位大牛遇到过这种情况么？怎么解决的？ ISE的Isim真是用不了 特么的跑一跑就挂掉。。。
【 以下文字转载自 Embedded_System 讨论区 】 发信人: BES (北邮嵌入式协会), 信区: Embedded_System 标 题: 嵌入式编程专家论坛暨第二届“顶嵌杯”大赛颁奖典礼活动通知 发信站: 北邮人论坛 (Wed Dec 22 20:19:16 2010), 站内 嵌入式编程专家论坛暨第二…
当初糊里糊涂就选了这门课，上课也没怎么听过，现在老师留了道作业如下： 请用FPGA或者DSP设计实现一个RSA/ECC签名验证模块或者JPEG编解码模块，功能模块图如下图所示。该功能模块是一个中断服务程序，放在FLASHROM中，由CPU的中断INT7调用。 要求： 1.编码算法可以选用现有的RSA、ECC加密算法或者…
跪求各位大牛解答，谢谢！
rt 当初说的技术支持是如何支持？选入的队伍和没被选入的队伍有什么区别？ 比较悲剧的没有被选上，如果自费参加，实验室条件是个比较难弄的东西。求指导。。。
大家好， 在智能车的官网（ www.fs-bupt.co.cc），我们已经公布了最终的入选名单( http://www.fs-bupt.co.cc/archives/42.html)，同时第一次技术沙龙通知–硬件篇 http://www.fs-bupt.co.cc/archives/48.html，敬请关注！ 预祝大家…
昨天逛某不知名论坛，发现STC出新款单片机了.... 其中15F104E吓到我了...第一次看到8脚的单片机... 内带振荡器，频率可调4--40M，温飘<1%，1T指令速度.... 不知道哪位大大有申请样片的资格，申请几片让大家把玩一番....
虽然ds18b20我有，也会用，但觉得比较麻烦，有简单的吗
附件(7.7KB) verilog.vim vim默认对verilog的缩进支持不是很好，很不方便。上网找了一个这个插件，方法是放入vimfiles/indent/中，效果挺好的
求教！！！
一个小弟问我怎么实现把一个U盘的数据拷到另外一个U盘里，当然不能在电脑上操作，用个简单的电路实现
求助了 需要一个经典的设计[ema3]
我设定了SIGNAL samePoleOneCnt:INTEGER RANGE 1 downto 0做奇偶判定，1奇0偶 然后再一个判定条件下使用语句samePoleOneCnt<=samePoleOneCnt+1; 现在问题是，在quartus下，当samePoleOneCnt=1时，再加一就成了零，即可以正确出结果…